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1
text
stringlengths
0
252
SC_CTOR(fetch){
SC_THREAD(fetching);
}
};
// Variavel para definicao do modelo implementado, sendo:
// - 0 para Modelo com threads e eventos
// - 1 para Modelo com módulos interligados por filas bloqueantes
#define MODELO 1
#if MODELO == 0
#include "stdarg.h"
#include "risc16.h"
#else
#include "stdarg.h"
#include "top.h"
#endif
// Enumeracao que representa o formato da instrucao
enum i_FORMAT {
TIPO_R=4, TIPO_I=3, TIPO_J=2
};
// Funcao para geracao de instrucoes na memoria
short gerainst(int n, ...) {
short inst = 0;
va_list ap;
va_start(ap, n);
switch (n) {
case TIPO_R:
inst |= (va_arg(ap, int ) & 0xF) << 12;
inst |= (va_arg(ap, int ) & 0xF) << 8;
inst |= (va_arg(ap, int ) & 0xF) << 4;
inst |= (va_arg(ap, int ) & 0xF);
break;
case TIPO_I:
inst |= (va_arg(ap, int ) & 0xF) << 12;
inst |= (va_arg(ap, int ) & 0xF) << 8;
inst |= (va_arg(ap, int ) & 0xF) << 4;
inst |= (va_arg(ap, int ) & 0xF);
break;
case TIPO_J:
inst |= (va_arg(ap, int ) & 0xF) << 12;
inst |= (va_arg(ap, int ) & 0xF) << 8;
inst |= (va_arg(ap, int ) & 0xFF);
break;
default:
break;
}
return inst;
}
int sc_main (int arc, char * argv[]){
#if MODELO == 0
////// Instanciacao do risc16
risc16 risc16_instance("risc16_instance");
cout << "|||||||||||||Modelo com Eventos|||||||||||||" << endl;
////// Escrevendo instrucoes na memoria
//// Aritmeticas
/* addi $1, 0 */
// Resultado esperado => reg1 += 0
risc16_instance.write_mem(0,gerainst(TIPO_J, i_ADDi, 1, 0));
/* addi $1, 8 */
// Resultado esperado => reg1 += 8
risc16_instance.write_mem(1,gerainst(TIPO_J, i_ADDi, 1, 8));
/* addi $2, -12 */
// Resultado esperado => reg2 -= 12
risc16_instance.write_mem(2,gerainst(TIPO_J, i_ADDi, 2, -12));
/* add $3, $2, $1 */
// Resultado esperado => reg3 = reg2 + reg1
risc16_instance.write_mem(3,gerainst(TIPO_R, i_ADD, 1, 2, 3));
/* sub $4, $2, $3 */
// Resultado esperado => reg4 = reg2 - reg3
risc16_instance.write_mem(4,gerainst(TIPO_R, i_SUB, 2, 3, 4));
/* add $5, $0, $1 */
// Resultado esperado => reg5 = reg1
risc16_instance.write_mem(5,gerainst(TIPO_R, i_ADD, 1, 0, 5));
/* shift $5, 2 */
// Resultado esperado => reg5 >> 2
risc16_instance.write_mem(6,gerainst(TIPO_J, i_SHIFT, 5, 2));
/* add $6, $0, $1 */
// Resultado esperado => reg6 = reg1